56F8002 View Datasheet(PDF) - Freescale Semiconductor
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56F8002 Datasheet PDF : 100 Pages
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Table of Contents
1 MC56F8006/MC56F8002 Family Configuration . . . . . . . . . . . .3
2 Block Diagram . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .4
3 Overview. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .4
3.1 56F8006/56F8002 Features . . . . . . . . . . . . . . . . . . . . . .4
3.2 Award-Winning Development Environment. . . . . . . . . . .8
3.3 Architecture Block Diagram. . . . . . . . . . . . . . . . . . . . . . .9
3.4 Product Documentation . . . . . . . . . . . . . . . . . . . . . . . .11
4 Signal/Connection Descriptions . . . . . . . . . . . . . . . . . . . . . . .11
4.1 Introduction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .11
4.2 Pin Assignment . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .13
4.3 56F8006/56F8002 Signal Pins . . . . . . . . . . . . . . . . . . .16
5 Memory Maps. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .28
5.1 Introduction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .28
5.2 Program Map . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .28
5.3 Data Map . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .29
5.4 Interrupt Vector Table and Reset Vector . . . . . . . . . . . .30
5.5 Peripheral Memory-Mapped Registers . . . . . . . . . . . . .31
5.6 EOnCE Memory Map . . . . . . . . . . . . . . . . . . . . . . . . . .32
6 General System Control Information . . . . . . . . . . . . . . . . . . .33
6.1 Overview . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .33
6.2 Power Pins . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .33
6.3 Reset. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .33
6.4 On-chip Clock Synthesis . . . . . . . . . . . . . . . . . . . . . . . .33
6.5 Interrupt Controller . . . . . . . . . . . . . . . . . . . . . . . . . . . .36
6.6 System Integration Module (SIM) . . . . . . . . . . . . . . . . .36
6.7 PWM, PDB, PGA, and ADC Connections. . . . . . . . . . .37
6.8 Joint Test Action Group (JTAG)/Enhanced On-Chip
Emulator (EOnCE) . . . . . . . . . . . . . . . . . . . . . . . . . . . .38
7 Security Features . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .38
7.1 Operation with Security Enabled. . . . . . . . . . . . . . . . . .39
7.2 Flash Access Lock and Unlock Mechanisms . . . . . . . .39
7.3 Product Analysis . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .40
8 Specifications . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 40
8.1 General Characteristics . . . . . . . . . . . . . . . . . . . . . . . . 40
8.2 Absolute Maximum Ratings. . . . . . . . . . . . . . . . . . . . . 41
8.3 Thermal Characteristics. . . . . . . . . . . . . . . . . . . . . . . . 42
8.4 Recommended Operating Conditions . . . . . . . . . . . . . 44
8.5 DC Electrical Characteristics . . . . . . . . . . . . . . . . . . . . 45
8.6 Supply Current Characteristics . . . . . . . . . . . . . . . . . . 49
8.7 Flash Memory Characteristics . . . . . . . . . . . . . . . . . . . 50
8.8 External Clock Operation Timing. . . . . . . . . . . . . . . . . 51
8.9 Phase Locked Loop Timing . . . . . . . . . . . . . . . . . . . . . 51
8.10 Relaxation Oscillator Timing . . . . . . . . . . . . . . . . . . . . 52
8.11 Reset, Stop, Wait, Mode Select, and Interrupt Timing. 53
8.12 External Oscillator (XOSC) Characteristics . . . . . . . . . 53
8.13 AC Electrical Characteristics . . . . . . . . . . . . . . . . . . . . 54
8.14 COP Specifications . . . . . . . . . . . . . . . . . . . . . . . . . . . 62
8.15 PGA Specifications . . . . . . . . . . . . . . . . . . . . . . . . . . . 62
8.16 ADC Specifications . . . . . . . . . . . . . . . . . . . . . . . . . . . 63
8.17 HSCMP Specifications . . . . . . . . . . . . . . . . . . . . . . . . 65
8.18 Optimize Power Consumption . . . . . . . . . . . . . . . . . . . 65
9 Design Considerations . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 67
9.1 Thermal Design Considerations . . . . . . . . . . . . . . . . . 67
9.2 Electrical Design Considerations. . . . . . . . . . . . . . . . . 68
9.3 Ordering Information . . . . . . . . . . . . . . . . . . . . . . . . . . 69
10 Package Mechanical Outline Drawings . . . . . . . . . . . . . . . . . 70
10.1 28-pin SOIC Package . . . . . . . . . . . . . . . . . . . . . . . . . 70
10.2 32-pin LQFP . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 73
10.3 48-pin LQFP . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 76
Appendix A
Interrupt Vector Table . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 78
Appendix B
Peripheral Register Memory Map and Reset Value . . . . . . . 80
MC56F8006/MC56F8002 Digital Signal Controller, Rev. 2
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Freescale Semiconductor
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